基于DDS IP核及Nios II的可重构信号源设计
2．7 SOPC硬件系统配置
在SOPC硬件系统的开发中，除了集成前面设计的DDSIP外，还集成了诸多SOPC Builder组件库中的标准组件，主要有Nios II CPU、UAR T、JTAG UART、定时器、Avalon三态总线桥、片上存储器、片外存储器、PIO、SDRAM控制器、FLASH控制器等，如图6所示。
3 结论
论文以直接数字频率合成技术为理论依据，开发了DDSIP核，搭建了基于SOPC技术的信号发生器硬件系统，通过改变LPM_ROM模块中的波形数据，可以实现任意波形信号的产生。系统除了数／模转换部分外，其它部分都是在FPGA内部完成，具有实现容易、方便，减小了PCB设计的复杂度以及开发难度，缩短了开发周期等优点，同时，系统还具有很大的伸缩性，系统集成度高，属于SOC的范畴，符合技术发展潮流。
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