FIR结构IQ串行处理RRC滤波器
考虑IIR与FIR等基本滤波器结构，由于相位的线性特性对实时通信具有重要的意义，并且RRC滤波器处于整个数字基带处理器的前端，其滤波性能，由量化效应导致的稳定性问题等，对后续系统有一定影响，故我们采用FIR结构，滤波器采用65阶，因为阶数并未超过256，且处理信号为基带信号，故RRC是一个低通滤波器，因此采用偶对称系数结构FIR滤波器。通过Matlab仿真我们可以得到如下的RRC滤波器幅度谱：
图中采用了f-sample=15.36MHz的采样频率对h(t)进行了采样，由冲击响应不变法形成了数字频率域上FIR结构滤波器的冲击响应系数，即FIR滤波系数。在频域上每隔10kHz对幅度函数进行采样，横轴采用归一化频率表示，由于采样是时域采样，所以频域上产生了周期性延拓。但是由此图可以看出，幅度谱还是基本能够满足成型滤波需求，又由于采取了FIR结构，故其系统函数可表示为
其中H(f)为如上RRC滤波器的频率域上的形势，
为FIR引入的相位延迟。并且由于是奇数阶FIR滤波器，系数呈现偶对称的关系，滤波器系数满足如下条件：
上文简要介绍了基于FIR结构RRC滤波器的基本原理与特性，下文重点描述在WCDMA基带芯片数字前端中如何串行模拟基带输送的并行IQ路数据。
2 IQ串行RRC滤波器
对于下行信号，按照25．213(release6)协议规定码片速率为3．84Mbps，考虑到采样定理与模拟基带普遍采用的调制方式，在模拟基带处使用16倍码片速率采样，即ABB采用61．44MHz频率主时钟采样信号，产生4bit的PDM码。其后DBB也采用16倍速对数据进行处理。当然RRC端输入数据已经经过降采样滤波器处理，采样数据降低为15．36MHz，即4倍速码片速率。但由于射频前段均采用IQ双通道结构，所以此时形成了I路与Q路两路并行数据流，因此需要两个RRC滤波器并行处理数据，因此使得系统资源大量浪费。所以本文进一步利用了4倍速码片速率并行IQ数据，添加了一个由计数器形成的控制部分，改变普通FIR滤波结构，复用了RRC的资源，同时完成了IQ两路数据流的处理。
2．1 IQ并串转换
首先将两路并行IQ数据降采样后进行并串转换，主时钟采用16倍速码片速率，为61．44MHz。转换控制由计数器完成，计数器为2bit，在高位为1时刻采样I路，在高位为0时刻采样Q路，整个转换过程如图3所示。
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